高級(jí)數(shù)字設(shè)計(jì)工程師-子公司深圳銳能微招聘
30000-40000元
珠海
5年以上
碩士
珠海
5年以上
碩士
- 全勤獎(jiǎng)
- 節(jié)日福利
- 不加班
- 周末雙休
職位描述
該職位還未進(jìn)行加V認(rèn)證,請(qǐng)仔細(xì)了解后再進(jìn)行投遞!
【崗位職責(zé)】
1. 根據(jù)需求制定芯片規(guī)格,完成芯片系統(tǒng)架構(gòu)設(shè)計(jì)、算法設(shè)計(jì)以及對(duì)應(yīng)的數(shù)字電路方案設(shè)計(jì),并完成相關(guān)仿真和文檔撰寫(xiě)
2. 數(shù)字模塊設(shè)計(jì):電能計(jì)量,數(shù)字信號(hào)處理和模擬電路控制等方向
3. 對(duì)初級(jí)工程師進(jìn)行電路基礎(chǔ)和設(shè)計(jì)方法培訓(xùn),并跟進(jìn)指導(dǎo)其設(shè)計(jì)任務(wù)的開(kāi)展
4. 輔助驗(yàn)證進(jìn)行驗(yàn)證點(diǎn)分解和評(píng)審
5. 完成設(shè)計(jì)檢查并指定后端流程進(jìn)行電路實(shí)現(xiàn):
設(shè)計(jì)規(guī)則檢查L(zhǎng)int
跨時(shí)鐘域處理CDC
電路綜合Synthesis
時(shí)序分析STA
可測(cè)性設(shè)計(jì)DFT
6. 參與系統(tǒng)調(diào)試、樣片驗(yàn)證、FPGA驗(yàn)證工作
【任職要求】
基本要求:
1. 集成電路、微電子和通信等電子類(lèi)專(zhuān)業(yè),全日制研究生以上學(xué)歷
2. 五年以上數(shù)字芯片設(shè)計(jì)工作經(jīng)驗(yàn),熟悉模塊設(shè)計(jì)、SoC、IP集成等某一專(zhuān)業(yè)領(lǐng)域
3. 熟練掌握數(shù)字電路的verilog描述
4. 掌握需求分析和轉(zhuǎn)化的基本方法,能設(shè)計(jì)優(yōu)化的,可拓展的電路架構(gòu)來(lái)實(shí)現(xiàn)芯片需求
5. 熟練掌握規(guī)格書(shū)、詳細(xì)設(shè)計(jì)等文檔編寫(xiě),能繪制結(jié)構(gòu)化的設(shè)計(jì)框圖
6. 熟練掌握后端設(shè)計(jì)(邏輯綜合、靜態(tài)時(shí)序分析、形式驗(yàn)證等)流程,及VCS、VERDI、VC Spayglass和DC等主流EDA工具的使用
7. 掌握RISC-V等CPU的集成與片上總線(AMBA:AHB/AXI/APB等協(xié)議的Bridge/Matrix)設(shè)計(jì)
8. 態(tài)度謙和,邏輯清晰,表達(dá)流暢,有團(tuán)隊(duì)合作精神
具有以下經(jīng)驗(yàn)優(yōu)先(一項(xiàng)或以上):
1. 數(shù)字信號(hào)處理算法的硬件實(shí)現(xiàn)
2. 電能計(jì)量芯片設(shè)計(jì)
3. 多電源域低功耗設(shè)計(jì)
4. UVM驗(yàn)證方法學(xué)
5. 項(xiàng)目或部門(mén)管理
6. 使用Python等腳本開(kāi)發(fā)設(shè)計(jì)和驗(yàn)證平臺(tái)
1. 根據(jù)需求制定芯片規(guī)格,完成芯片系統(tǒng)架構(gòu)設(shè)計(jì)、算法設(shè)計(jì)以及對(duì)應(yīng)的數(shù)字電路方案設(shè)計(jì),并完成相關(guān)仿真和文檔撰寫(xiě)
2. 數(shù)字模塊設(shè)計(jì):電能計(jì)量,數(shù)字信號(hào)處理和模擬電路控制等方向
3. 對(duì)初級(jí)工程師進(jìn)行電路基礎(chǔ)和設(shè)計(jì)方法培訓(xùn),并跟進(jìn)指導(dǎo)其設(shè)計(jì)任務(wù)的開(kāi)展
4. 輔助驗(yàn)證進(jìn)行驗(yàn)證點(diǎn)分解和評(píng)審
5. 完成設(shè)計(jì)檢查并指定后端流程進(jìn)行電路實(shí)現(xiàn):
設(shè)計(jì)規(guī)則檢查L(zhǎng)int
跨時(shí)鐘域處理CDC
電路綜合Synthesis
時(shí)序分析STA
可測(cè)性設(shè)計(jì)DFT
6. 參與系統(tǒng)調(diào)試、樣片驗(yàn)證、FPGA驗(yàn)證工作
【任職要求】
基本要求:
1. 集成電路、微電子和通信等電子類(lèi)專(zhuān)業(yè),全日制研究生以上學(xué)歷
2. 五年以上數(shù)字芯片設(shè)計(jì)工作經(jīng)驗(yàn),熟悉模塊設(shè)計(jì)、SoC、IP集成等某一專(zhuān)業(yè)領(lǐng)域
3. 熟練掌握數(shù)字電路的verilog描述
4. 掌握需求分析和轉(zhuǎn)化的基本方法,能設(shè)計(jì)優(yōu)化的,可拓展的電路架構(gòu)來(lái)實(shí)現(xiàn)芯片需求
5. 熟練掌握規(guī)格書(shū)、詳細(xì)設(shè)計(jì)等文檔編寫(xiě),能繪制結(jié)構(gòu)化的設(shè)計(jì)框圖
6. 熟練掌握后端設(shè)計(jì)(邏輯綜合、靜態(tài)時(shí)序分析、形式驗(yàn)證等)流程,及VCS、VERDI、VC Spayglass和DC等主流EDA工具的使用
7. 掌握RISC-V等CPU的集成與片上總線(AMBA:AHB/AXI/APB等協(xié)議的Bridge/Matrix)設(shè)計(jì)
8. 態(tài)度謙和,邏輯清晰,表達(dá)流暢,有團(tuán)隊(duì)合作精神
具有以下經(jīng)驗(yàn)優(yōu)先(一項(xiàng)或以上):
1. 數(shù)字信號(hào)處理算法的硬件實(shí)現(xiàn)
2. 電能計(jì)量芯片設(shè)計(jì)
3. 多電源域低功耗設(shè)計(jì)
4. UVM驗(yàn)證方法學(xué)
5. 項(xiàng)目或部門(mén)管理
6. 使用Python等腳本開(kāi)發(fā)設(shè)計(jì)和驗(yàn)證平臺(tái)
工作地點(diǎn)
地址:珠海香洲區(qū)福臨道
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2026-01-11 07:44:01
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