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【崗位職責(zé)】 1、端到端負(fù)責(zé)WSS模塊的邏輯方案設(shè)計(jì)、RTL實(shí)現(xiàn)及驗(yàn)證，主導(dǎo)光路控制算法、LCoS驅(qū)動、溫度補(bǔ)償/控制等關(guān)鍵子系統(tǒng)的開發(fā)與優(yōu)化； 2、完成光通信系統(tǒng)高速信號鏈路（ADC/DAC、SerDes、PCIe、DDR等）的FPGA邏輯設(shè)計(jì)與聯(lián)調(diào)，協(xié)同硬件、光學(xué)、軟件團(tuán)隊(duì)進(jìn)行系統(tǒng)級性能閉環(huán)優(yōu)化； 3、主導(dǎo)或參與產(chǎn)品全生命周期：需求分解→方案評審→代碼實(shí)現(xiàn)→板級調(diào)試→量產(chǎn)維護(hù)→技術(shù)迭代，持續(xù)沉淀IP、文檔與專利； 4、跟蹤LCoS及WSS領(lǐng)域最新技術(shù)，預(yù)研下一代可重構(gòu)光網(wǎng)絡(luò)關(guān)鍵算法與實(shí)現(xiàn)架構(gòu)。 【任職資格】 必備能力 ? 5年以上FPGA邏輯開發(fā)經(jīng)驗(yàn)，精通Verilog/SystemVerilog/VHDL，熟練運(yùn)用Vivado、Quartus或Pango全流程工具鏈； ? 深入理解高速數(shù)字設(shè)計(jì)：時(shí)序約束、CDC、低功耗與資源優(yōu)化，具備量產(chǎn)級調(diào)試與問題定位能力； ? 熟練掌握PCIe、SerDes、DDR等高速接口協(xié)議及實(shí)現(xiàn)； ? 具備將光學(xué)/控制算法（如全息圖生成、PID）高效映射至FPGA的實(shí)踐經(jīng)驗(yàn)，能夠獨(dú)立完成子系統(tǒng)設(shè)計(jì)。 加分項(xiàng) ? 有WSS、ROADM、相干光模塊等光通信設(shè)備開發(fā)經(jīng)歷； ? 熟悉LCoS空間光調(diào)制器驅(qū)動、溫控及圖像處理鏈路； ? 具備光學(xué)背景或跨學(xué)科（光學(xué) 數(shù)字）系統(tǒng)聯(lián)調(diào)經(jīng)驗(yàn)； ? 發(fā)表過相關(guān)專利或高水平論文。